職位描述
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職位描述:
職責(zé)描述:
1. 負(fù)責(zé)總體設(shè)計中的邏輯設(shè)計與資源評估;
2. 進(jìn)行產(chǎn)品系統(tǒng)設(shè)計,設(shè)計合適的算法及選擇實現(xiàn)架構(gòu);
3. 對系統(tǒng)設(shè)計進(jìn)行拆分細(xì)化,實現(xiàn)復(fù)雜系統(tǒng)的詳細(xì)設(shè)計,定于各模塊接口;
4. 編寫完成所負(fù)責(zé)功能模塊的概要設(shè)計、詳細(xì)設(shè)計等文檔;
5. 編寫負(fù)責(zé)模塊的仿真平臺,建立測試用例并完成模塊的設(shè)計驗證;
6. 進(jìn)行fpga板卡的調(diào)試,配合完成模塊間的聯(lián)調(diào)和產(chǎn)品集成測試;
7. 參與系統(tǒng)方案討論,編寫fpga邏輯設(shè)計方案及系統(tǒng)測試方案;
8. 參與技術(shù)業(yè)務(wù)制定流程及與其他部門的協(xié)調(diào)工作;
9.解決系統(tǒng)中遇到的軟件問題。
任職要求:
1.大學(xué)本科及以上學(xué)歷,電子工程類、信號處理等相關(guān)專業(yè);
2.五年及以fpga開發(fā)經(jīng)驗;
3.具有良好的數(shù)字電路、模擬電路基本知識;
4.熟練掌握fpga、dsp的開發(fā)流程,具有xilinx、alterax等主流fpga的開發(fā)經(jīng)驗;
5.具有verilog編程經(jīng)驗,熟練使用fpga開發(fā)、仿真、調(diào)試相關(guān)軟件;
6. 有ddr、qdr、pcie、emmc、sata、uart的fpga程序編寫經(jīng)驗,熟悉rapidio接口;
7. 具有高速adc、dac芯片調(diào)試經(jīng)驗;
8.能夠熟練使用頻譜儀、示波器、信號源等常用儀表;
9.具良好的心態(tài),有正確的職業(yè)觀;
10.耐心細(xì)致,有責(zé)任心,工作勤奮,善于思考問題;
11.有時間觀念,獨(dú)立性強(qiáng),具有團(tuán)隊合作精神。
職責(zé)描述:
1. 負(fù)責(zé)總體設(shè)計中的邏輯設(shè)計與資源評估;
2. 進(jìn)行產(chǎn)品系統(tǒng)設(shè)計,設(shè)計合適的算法及選擇實現(xiàn)架構(gòu);
3. 對系統(tǒng)設(shè)計進(jìn)行拆分細(xì)化,實現(xiàn)復(fù)雜系統(tǒng)的詳細(xì)設(shè)計,定于各模塊接口;
4. 編寫完成所負(fù)責(zé)功能模塊的概要設(shè)計、詳細(xì)設(shè)計等文檔;
5. 編寫負(fù)責(zé)模塊的仿真平臺,建立測試用例并完成模塊的設(shè)計驗證;
6. 進(jìn)行fpga板卡的調(diào)試,配合完成模塊間的聯(lián)調(diào)和產(chǎn)品集成測試;
7. 參與系統(tǒng)方案討論,編寫fpga邏輯設(shè)計方案及系統(tǒng)測試方案;
8. 參與技術(shù)業(yè)務(wù)制定流程及與其他部門的協(xié)調(diào)工作;
9.解決系統(tǒng)中遇到的軟件問題。
任職要求:
1.大學(xué)本科及以上學(xué)歷,電子工程類、信號處理等相關(guān)專業(yè);
2.五年及以fpga開發(fā)經(jīng)驗;
3.具有良好的數(shù)字電路、模擬電路基本知識;
4.熟練掌握fpga、dsp的開發(fā)流程,具有xilinx、alterax等主流fpga的開發(fā)經(jīng)驗;
5.具有verilog編程經(jīng)驗,熟練使用fpga開發(fā)、仿真、調(diào)試相關(guān)軟件;
6. 有ddr、qdr、pcie、emmc、sata、uart的fpga程序編寫經(jīng)驗,熟悉rapidio接口;
7. 具有高速adc、dac芯片調(diào)試經(jīng)驗;
8.能夠熟練使用頻譜儀、示波器、信號源等常用儀表;
9.具良好的心態(tài),有正確的職業(yè)觀;
10.耐心細(xì)致,有責(zé)任心,工作勤奮,善于思考問題;
11.有時間觀念,獨(dú)立性強(qiáng),具有團(tuán)隊合作精神。
工作地點
地址:北京海淀區(qū)北京


職位發(fā)布者
HR
北京東遠(yuǎn)潤興科技有限公司

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航空/航天研究與制造
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51-99人
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公司性質(zhì)未知
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海淀區(qū)昆明湖南路51號軍民融合產(chǎn)業(yè)園c座210
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